No desenvolvimento concorrente de microsserviços do Tribunal, a escolha entre processos e threads é crucial para otimizar o uso da CPU. À luz das diferenças estruturais de processos e threads, é correto afirmar:
- A) Threads pertencentes a um mesmo processo pai compartilham o espaço de endereçamento de memória e os arquivos abertos, mas mantêm pilhas e contadores de programa privados.
- B) Processos de diferentes aplicações compartilham o mesmo espaço de endereçamento de memória lógica, dispensando operações de troca de contexto no kernel.
- C) A troca de contexto entre threads de um mesmo processo é uma operação significativamente mais pesada que entre processos, pois exige a invalidação do cache da MMU.
Durante a execução de uma consulta ao banco de dados pelo PJe, o processo correspondente transita entre diferentes estados lógicos. A transição do estado de Executando para o de Bloqueado ocorre quando o processo:
- A) É interrompido pelo escalonador de CPU devido à expiração do seu quantum de tempo em um sistema puramente preemptivo.
- B) Solicita voluntariamente uma operação de Entrada/Saída, como a leitura de uma peça processual em PDF armazenada no storage do Tribunal.
- C) É selecionado pelo escalonador (despacho) na fila de prontos para ocupar imediatamente o processador físico.
Para evitar paralisações nos servidores de armazenamento do Tribunal, os analistas de infraestrutura devem mitigar o risco de impasses (deadlocks). A respeito do **Algoritmo do Banqueiro** de Dijkstra:
- A) Atua na estratégia de evasão (avoidance), analisando dinamicamente o estado do sistema para garantir que a alocação de recursos mantenha o sistema em um estado seguro.
- B) Funciona como uma técnica de prevenção de deadlocks, quebrando diretamente a condição de exclusão mútua por meio de pools virtuais de hardware.
- C) É classificado como uma rotina de detecção e recuperação tardia, atuando apenas após a ocorrência do deadlock para forçar o encerramento do kernel.
O sistema de virtualização do Tribunal gerencia a memória física por paginação ou segmentação. Ao comparar as propriedades de paginação e segmentação, conclui-se que:
- A) A segmentação divide a memória em blocos físicos de tamanho fixo, sofrendo exclusivamente de fragmentação interna que inutiliza o cache L3.
- B) Ambas as técnicas sofrem de fragmentação externa, visto que dividem a memória de forma puramente estática e são visíveis ao programador.
- C) A paginação divide a memória em blocos físicos de tamanho fixo (frames) e sofre de fragmentação interna, enquanto a segmentação usa blocos lógicos de tamanho variável.
Os servidores de banco de dados do Tribunal lidam com alta taxa de leitura e escrita de petições. Para otimizar a performance de E/S com o uso de **Direct Memory Access (DMA)**:
- A) A CPU é dispensada de transferir os dados byte a byte, delegando a tarefa ao controlador de DMA, que transfere blocos diretamente à memória RAM.
- B) A CPU deve ser interrompida pelo barramento a cada byte transferido, exigindo o monitoramento contínuo em laço de repetição ativo (busy-waiting).
- C) O DMA elimina completamente a necessidade de qualquer interrupção física ou lógica enviada à CPU, mesmo após a conclusão de toda a transferência de dados.
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